{"id":18713,"date":"2026-04-04T15:03:28","date_gmt":"2026-04-04T13:03:28","guid":{"rendered":"https:\/\/webhosting.de\/server-interrupt-handling-cpu-performance-optimization-7342\/"},"modified":"2026-04-04T15:03:28","modified_gmt":"2026-04-04T13:03:28","slug":"ottimizzazione-delle-prestazioni-della-cpu-per-la-gestione-degli-interrupt-del-server-7342","status":"publish","type":"post","link":"https:\/\/webhosting.de\/it\/server-interrupt-handling-cpu-performance-optimization-7342\/","title":{"rendered":"Gestione degli interrupt sui server: come gli interrupt della CPU influenzano le prestazioni"},"content":{"rendered":"<p>Gli interrupt della CPU controllano la velocit\u00e0 con cui il server risponde ai pacchetti di rete, agli eventi di storage e ai timer: interruzioni distribuite in modo errato o troppo frequenti rallentano le applicazioni in modo misurabile. Un server con una gestione pulita degli interrupt riduce gli switch di contesto, abbassa le latenze e stabilizza i tempi di risposta durante i picchi di carico.<\/p>\n\n<h2>Punti centrali<\/h2>\n<p>Prima di entrare nel dettaglio, riassumer\u00f2 i seguenti aspetti chiave:<\/p>\n<ul>\n  <li><strong>Carico di interruzione<\/strong> capire: Quando i valori percentuali diventano critici<\/li>\n  <li><strong>Parallelismo<\/strong> gestire: interrupt simultanei e latenze del caso peggiore<\/li>\n  <li><strong>MSI-X<\/strong> utilizzo: Pi\u00f9 notizie, migliore distribuzione<\/li>\n  <li><strong>RSS<\/strong> Affinit\u00e0: collocare gli interrupt della NIC sui core<\/li>\n  <li><strong>Monitoraggio<\/strong> stabilire: Leggere i numeri, agire in modo mirato<\/li>\n<\/ul>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img fetchpriority=\"high\" decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/server-performance-4561.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>Cosa fa scattare gli interrupt della CPU sui server<\/h2>\n\n<p>Un'interruzione \u00e8 un <strong>Segnale<\/strong>, che interrompe immediatamente l'attivit\u00e0 corrente della CPU e avvia un gestore. Le schede di rete segnalano nuovi pacchetti, i controller di archiviazione segnalano l'I\/O completato, i timer attivano gli orologi: ognuno di questi interrupt costa denaro. <strong>tempo di CPU<\/strong>. Con un'attivit\u00e0 elevata, questi eventi si sommano a molti context switch e cache miss. Per questo motivo, monitoro la frequenza e il tempo che la CPU del kernel dedica alle ISR e ai DPC. Se si comprendono queste dinamiche, \u00e8 possibile controllare i tempi di risposta in modo affidabile e far funzionare le applicazioni in modo sensibilmente pi\u00f9 fluido.<\/p>\n\n<h2>Perch\u00e9 i tempi di interruzione elevati costano le prestazioni<\/h2>\n\n<p>In ambienti sani, le interruzioni del sistema sono di solito comprese tra <strong>0,1-2%<\/strong> CPU, 3-7% sono possibili a breve termine. Se il tempo di interruzione rimane regolarmente al di sopra di 5-10%, spesso si tratta di un problema di driver, di hardware difettoso o di tuning errato. A partire da 30% la situazione si fa seria, oltre 50% c'\u00e8 la minaccia di <strong>Colli di bottiglia<\/strong> e tempi di risposta lenti. Le applicazioni perdono throughput, le latenze saltano e la prevedibilit\u00e0 ne risente. Per prima cosa controllo le versioni dei driver, il firmware, le affinit\u00e0 e la moderazione degli interrupt sulle NIC.<\/p>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/server_interrupts_1234.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>Interruzioni simultanee: capire le latenze<\/h2>\n\n<p>Un singolo interrupt raramente rimane un <strong>Problema<\/strong>; Diventa difficile quando diversi eventi si scontrano. Se un interrupt ad alta priorit\u00e0 si verifica durante un interrupt a bassa priorit\u00e0, la sua elaborazione viene prolungata da ulteriori interruzioni. Un esempio: se il percorso ad alta priorit\u00e0 richiede 75 cicli e quello a bassa priorit\u00e0 50, la latenza del percorso a bassa priorit\u00e0 sale facilmente a 125 cicli - ulteriori sovrapposizioni aumentano la latenza. <strong>Il caso peggiore<\/strong>-La latenza aumenta rapidamente. Questo comportamento rende i sistemi imprevedibili. Pertanto, pianifico le affinit\u00e0 e le priorit\u00e0 del nucleo in modo tale che i percorsi caldi non si blocchino a vicenda.<\/p>\n\n<h2>MSI e MSI-X nell'uso quotidiano<\/h2>\n\n<p>Gli host moderni utilizzano MSI o <strong>MSI-X<\/strong>, invece di inviare i classici segnali di linea (linee IRQ). MSI trasmette il messaggio come scrittura in memoria, riducendo cos\u00ec la latenza e la suscettibilit\u00e0 alle interferenze. MSI-X estende il concetto: pi\u00f9 messaggi, code separate, distribuzione pi\u00f9 precisa ai core. In questo modo si riducono le collisioni di interrupt e si migliora il <strong>Scala<\/strong> con un throughput elevato. Attivo MSI-X per le schede NIC e i controller NVMe, purch\u00e9 i driver e il firmware lo supportino in modo stabile.<\/p>\n\n<table>\n  <thead>\n    <tr>\n      <th>meccanismo<\/th>\n      <th>Max. Messaggi<\/th>\n      <th>Indirizzamento<\/th>\n      <th>Distribuzione ai core<\/th>\n      <th>Effetto tipico<\/th>\n    <\/tr>\n  <\/thead>\n  <tbody>\n    <tr>\n      <td>IRQ legacy<\/td>\n      <td>1 per dispositivo\/linea<\/td>\n      <td>Segnale di linea<\/td>\n      <td>Limitato<\/td>\n      <td>Pi\u00f9 alto <strong>Latenza<\/strong>, pi\u00f9 collisioni<\/td>\n    <\/tr>\n    <tr>\n      <td>MSI<\/td>\n      <td>Fino a ~32<\/td>\n      <td>Scrittura di memoria (16 bit)<\/td>\n      <td>Buono<\/td>\n      <td>Meno spese generali, percorsi pi\u00f9 stabili<\/td>\n    <\/tr>\n    <tr>\n      <td>MSI-X<\/td>\n      <td>Fino al 2048<\/td>\n      <td>Scrittura di memoria (32 bit)<\/td>\n      <td>Molto buono<\/td>\n      <td>Pi\u00f9 fine <strong>Distribuzione<\/strong>, parallelismo superiore<\/td>\n    <\/tr>\n  <\/tbody>\n<\/table>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/server-cpu-interrupts-performance-4821.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>DMA, DPC e il giusto percorso dei dati<\/h2>\n\n<p>Con il DMA, i dispositivi possono memorizzare i dati direttamente nella memoria di <strong>Memoria<\/strong> La CPU attiva solo le routine di elaborazione. In questo modo si risparmiano gli interrupt, perch\u00e9 devono essere segnalati meno stati intermedi. Mi assicuro che i DPC raggruppino il lavoro effettivo invece di fare troppo nell'ISR. In questo modo, il tempo nella sezione critica \u00e8 breve e il tempo di elaborazione \u00e8 ridotto. <strong>Latenza<\/strong> pi\u00f9 prevedibile. Nel complesso, la CPU guadagna pi\u00f9 tempo per la logica applicativa.<\/p>\n\n<h2>Configurare in modo specifico l'affinit\u00e0 RSS e CPU<\/h2>\n\n<p>Il Receive Side Scaling distribuisce le code di rete e i relativi interrupt su pi\u00f9 <strong>nuclei<\/strong>. Lego ogni coda, compresi interrupt, DPC e thread utente, allo stesso core o cluster di core per evitare scosse incrociate tra core. Se in un flusso sono coinvolti diversi core, aumentano le perdite di cache e i context switch. Un piano di affinit\u00e0 strutturato evita notevolmente queste perdite per attrito. Se si desidera approfondire, \u00e8 possibile trovare una guida compatta <a href=\"https:\/\/webhosting.de\/it\/server-cpu-affinita-hosting-ottimizzazione-kernelaffinity\/\">Affinit\u00e0 della CPU<\/a>-Panoramica delle configurazioni di hosting.<\/p>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/cpu_interrupts_nachtbild_4832.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>Disinnescare gli interrupt di archiviazione e i percorsi di I\/O<\/h2>\n\n<p>Lo stoccaggio genera anche molti <strong>Interruzioni<\/strong>, soprattutto con molti piccoli IOPS. Uso MSI-X sui controller NVMe e assegno le code a core fissi in modo che l'input e l'output rimangano locali. Inoltre, un'adeguata <a href=\"https:\/\/webhosting.de\/it\/io-scheduler-linux-noop-mq-deadline-bfq-serverboost\/\">Schedulatore I\/O<\/a>, per attenuare il carico per coda. Le varianti Deadline, BFQ o MQ reagiscono in modo molto diverso a seconda del carico di lavoro. Se si esegue il test in modo corretto, si riduce il jitter e si aumenta la <strong>Produttivit\u00e0<\/strong>.<\/p>\n\n<h2>Tempeste di rete, SYN flood e moderazione delle interruzioni<\/h2>\n\n<p>Improvvise inondazioni di pacchi spingono la <strong>PVR<\/strong>-e togliere il fiato alla CPU. Attivo la moderazione degli interrupt sulla NIC, in modo che i pacchetti arrivino in raffiche ragionevoli senza generare picchi di latenza. Per gli scenari DoS, un sistema resiliente di <a href=\"https:\/\/webhosting.de\/it\/syn-flood-protection-gestione-dei-socket-difesa-dei-server\/\">Difesa dalle inondazioni SYN<\/a> la tabella delle connessioni in una fase iniziale. Allo stesso tempo, misuro se la moderazione stessa reagisce troppo lentamente, quindi regolo i valori. L'obiettivo \u00e8 ottenere un flusso di pacchetti omogeneo che distribuisca uniformemente i DPC. <strong>alimentazioni<\/strong>.<\/p>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/cpu_interrupts_server_3416.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>Monitoraggio: leggere e agire sui dati<\/h2>\n\n<p>Inizio con pochi, chiari <strong>Metriche<\/strong>Utilizzo totale della CPU, tempo di interruzione, tempo DPC, cambio di contesto e coda del processore. Se la CPU rimane generalmente al di sotto di 50%, reagisco con calma; a 50-80% osservo i picchi e gli hotspot; al di sopra di 80% pianifico il ridimensionamento o la messa a punto. Se il tempo di interruzione supera i 30%, controllo il driver, il firmware e le affinit\u00e0. Un controllo della latenza per l'audio\/video mostra indirettamente la determinatezza della reazione del kernel. Importante: modifico solo un <strong>Variabile<\/strong> per ogni prova e poi misurare di nuovo.<\/p>\n\n<h2>Topologia NUMA e localizzazione PCIe<\/h2>\n\n<p>Sugli host multi-socket, decido sempre le affinit\u00e0 di interruzione nel contesto dell'ambiente di lavoro di <strong>NUMA<\/strong>-topologia. Un NIC o un controller NVMe \u00e8 fisicamente collegato a un complesso root PCIe e quindi a un nodo NUMA. Se imposto le code e i loro interrupt su <em>distante<\/em> i dati viaggiano attraverso i collegamenti UPI\/QPI: le latenze aumentano, la larghezza di banda diminuisce. Pertanto, controllo a quale nodo NUMA \u00e8 assegnato un dispositivo, lego le sue code ai core locali e mi assicuro che i thread utente associati utilizzino lo stesso nodo. Su Windows, faccio attenzione ai gruppi di processori e all'impostazione del dispositivo per il nodo NUMA preferito; su Linux, collego costantemente IRQ, softirq e thread applicativi al nodo locale. Il risultato: meno traffico tra i nodi, maggiore stabilit\u00e0. <strong>Jitter<\/strong>-e latenze calcolabili nel caso peggiore.<\/p>\n\n<h2>Utilizzo corretto di offload, NAPI e coalescenza<\/h2>\n\n<p>Gli offload sono potenti leve contro l'interrupt flood, ma devono essere usati per <strong>Carico di lavoro<\/strong> in forma. Riassumendo: TSO\/GSO spostano la segmentazione sulla NIC, LRO\/GRO riassumono i segmenti in arrivo, RSC sull'host ha un effetto simile a LRO. Per i trasferimenti di massa (backup, replica), queste caratteristiche aumentano il throughput e riducono significativamente il tasso di ISR. Tuttavia, per i flussi critici in termini di latenza (RPC, trading, VoIP), le grandi aggregazioni possono avere un impatto negativo sul tasso di PVR. <em>Tempi di risposta<\/em> estendere. Pertanto, scelgo impostazioni moderate: GRO s\u00ec, ma senza esagerare; LRO solo se nessun dispositivo o firewall di medio percorso crea problemi; lasciare TSO\/GSO attivo come regola. <\/p>\n\n<p>NAPI su Linux passa dalla modalit\u00e0 di interrupt puro alla modalit\u00e0 di polling a partire dal carico. In questo modo si attenuano i picchi e si tiene occupata la CPU nel percorso DPC, invece di innescare migliaia di brevi ISR. Insieme a <strong>Interruzione della moderazione<\/strong> (coalescenza), viene creato un piano: timer brevi per i profili interattivi, timer pi\u00f9 lunghi per quelli di massa. Testiamo gli intervalli con incrementi di microsecondi, osserviamo le cadute, i livelli di riempimento degli anelli e le latenze per trovare il punto giusto. Nello stack di archiviazione, le viti di regolazione analogiche (profondit\u00e0 della coda, NCQ, ottimizzazioni blk-mq) producono lo stesso effetto: meno staccato, pi\u00f9 <strong>Efficienza<\/strong>.<\/p>\n\n<h2>Bilanciamento IRQ vs. pinning statico<\/h2>\n\n<p>Il bilanciamento automatico degli IRQ distribuisce il carico in modo accettabile, ma non perfetto. In ambienti web omogenei, spesso lo lascio in funzione e controllo solo gli hotspot. Nelle configurazioni critiche per la latenza o asimmetriche <strong>Pinzatura statica<\/strong> superiore: Definisco set di CPU fissi per ogni coda e dispositivo, li mantengo coerenti attraverso i riavvii e riduco al minimo la migrazione delle softirq. Inoltre, riservo i core \u201edi mantenimento\u201c per il lavoro in background (timer, Kthread) in modo che i core per le prestazioni rimangano liberi. Su Windows, utilizzo specificamente il pilotaggio degli interrupt e le maschere di affinit\u00e0 per ogni coda; su Linux, lavoro con l'affinit\u00e0 per-IRQ e il controllo delle Softirq. Il motto: tutta l'automazione necessaria, tutta l'automazione necessaria. <strong>Determinismo<\/strong> il pi\u00f9 possibile.<\/p>\n\n<h2>Virtualizzazione e SR-IOV\/virgolette<\/h2>\n\n<p>Nelle macchine virtuali sorgono costi aggiuntivi: gli interrupt virtuali significano <em>Uscita della macchina virtuale<\/em>, ritardi di schedulazione e code condivise. Collego le vCPU ad alta intensit\u00e0 di I\/O a pCPU adeguate, evito l'overcommit sugli host di I\/O e separo i thread del dataplane dal carico di gestione. Dove possibile, utilizzo <strong>SR-IOV<\/strong>Le funzioni virtuali portano MSI-X alla VM guest e riducono il carico sul percorso dell'hypervisor. Per i carichi di lavoro generici, virtio con l'accelerazione vhost offre risultati solidi; negli scenari ad alto rendimento, mappo le code 1:1 alle vCPU e mantengo le affinit\u00e0 coerenti da guest a host. Importante: le stesse regole per RSS, coalescenza e NUMA sono valide anche per le macchine virtuali, solo che il <strong>Trasparenza<\/strong> \u00e8 pi\u00f9 basso, quindi misuro pi\u00f9 attentamente.<\/p>\n\n<h2>Gestione dell'alimentazione e latenze deterministiche<\/h2>\n\n<p>Le funzioni di risparmio energetico sono buone per il bilancio, ma cattive per il lavoro. <strong>Budget di latenza<\/strong>. Gli stati C profondi allungano il tempo di risveglio e le variazioni di frequenza aggressive causano jitter. Sugli host con SLO rigorosi, imposto profili di prestazioni, limito gli stati C profondi del pacchetto e permetto il turbo solo quando la riserva termica \u00e8 sufficientemente ampia. Anche le decisioni relative ai timer (timer ad alta risoluzione o frequenza di interrupt inferiore) influenzano la quantit\u00e0 e la velocit\u00e0 di lavoro del kernel. Nelle configurazioni quasi in tempo reale, le modalit\u00e0 tickless e i core isolati sono d'aiuto: i thread delle applicazioni sui core isolati, il lavoro di sistema sui core \u201edi mantenimento\u201c dedicati - in modo che i core critici <strong>Percorso caldo<\/strong> libero da incendi interferenti.<\/p>\n\n<h2>Strumenti e metodologia di misurazione per OS<\/h2>\n\n<p>Tengo il mio <strong>Catena diagnostica<\/strong> snello e riproducibile. Su Linux inizio con \/proc\/interrupts e \/proc\/softirqs, controllo i contatori per-queue tramite ethtool ed esamino le impostazioni di coalescenza e offload. mpstat, vmstat e sar mostrano le tendenze macro; perf scopre i punti caldi nelle ISR\/DPC. Metto in relazione i contatori dei pacchetti e dei drop con i tempi del kernel e le metriche di flusso. Su Windows, gli indicatori di prestazione sul tempo di interrupt\/DPC, interrupt\/sec e DPC\/sec forniscono un quadro chiaro; le tracce mostrano quali driver stanno regolando il tempo. Importante \u00e8 il comune <strong>Scala temporale<\/strong>Registro tutto in modo sincronizzato in modo che i picchi, le cadute e i salti di latenza corrispondano.<\/p>\n\n<h2>Playbook e anti-pattern per la risoluzione dei problemi<\/h2>\n\n<p>La mia procedura \u00e8 coerente: prima <strong>Osservare<\/strong>, poi un'ipotesi, quindi una modifica. Le cause tipiche sono: una coda o un dispositivo con un tasso crescente di PVR, un firmware difettoso, valori di coalescenza troppo alti (sistema duro) o troppo bassi (tempesta di PVR), offload troppo grandi o thread che tirano le code attraverso i nodi NUMA. Isolo il dispositivo interessato, verifico le impostazioni predefinite, modifico i driver\/BIOS e distribuisco il carico in modo pulito. Antipattern: spostare tutto allo stesso tempo, rollback disordinati, nessuna linea di base o letture senza contesto. Se si utilizza costantemente un dispositivo <strong>Variabile<\/strong> dopo l'altro, si arriver\u00e0 rapidamente a una configurazione stabile.<\/p>\n\n<h2>Progetti per host 10\/25\/100G e NVMe<\/h2>\n\n<p>Per le NIC 10G, calcolo 4-8 code RSS, a seconda della generazione di CPU e del profilo dei pacchetti. Inizio la coalescenza con moderazione (ad esempio, microsecondi a due cifre), GRO on, LRO con attenzione. A 25G passo a 8-16 code e mantengo l'affinit\u00e0 strettamente NUMA-local. A partire da 40\/100G, l'architettura delle code diventa il <strong>Compito principale<\/strong>Molte code, allocazione pulita per core, offload attivo, il NAPI entra in funzione sotto carico. Per lo storage NVMe, mappo almeno una coda per core e mantengo la profondit\u00e0 della coda adatta al carico di lavoro: i piccoli I\/O beneficiano di un maggiore parallelismo, i trasferimenti sequenziali di grandi dimensioni di una politica di coalescenza stabile e di uno scheduler che attenua i burst. L'obiettivo rimane lo stesso: latenze costanti, nessun core caldo, nessun anello traboccante.<\/p>\n\n<h2>Lista di controllo pratica per un rapido successo<\/h2>\n\n<p>Io aggiorno per primo <strong>Autisti<\/strong> e BIOS\/firmware, perch\u00e9 gli stati difettosi spesso aumentano il carico di interrupt. Poi, se possibile, passo a MSI-X e distribuisco le code in modo pulito ai core. Configuro l'RSS in modo che le affinit\u00e0 di flusso siano corrette e gli hotpath siano coerenti. Sul NIC, adatto la moderazione al profilo di traffico e osservo l'effetto sulle latenze. Se continuo a trovare valori anomali, cerco hardware difettoso, opzioni non corrette o dispositivi problematici utilizzando la procedura di esclusione e una procedura separata. <strong>Profilazione<\/strong>.<\/p>\n\n<h2>Valutare realisticamente costi e benefici<\/h2>\n\n<p>Non tutti i sistemi hanno bisogno del massimo <strong>Sintonizzazione fine<\/strong>. Do la priorit\u00e0 agli host con un carico di pacchetti elevato, molti IOPS ridotti o specifiche di latenza ristrette. Alcune ore di messa a punto sono molto utili in questo caso, perch\u00e9 la riduzione dell'overhead degli interrupt libera immediatamente la CPU per l'applicazione. Sui server non critici, \u00e8 sufficiente una solida configurazione di base con i driver pi\u00f9 recenti e MSI-X. Sono i valori misurati a guidarmi, non le sensazioni di pancia o le <strong>Ipotesi<\/strong>.<\/p>\n\n\n<figure class=\"wp-block-image size-full is-resized\">\n  <img loading=\"lazy\" decoding=\"async\" src=\"https:\/\/webhosting.de\/wp-content\/uploads\/2026\/04\/interrupt-serverraum-1275.png\" alt=\"\" width=\"1536\" height=\"1024\"\/>\n<\/figure>\n\n\n<h2>Sommario: Cosa metto in valigia per la manutenzione quotidiana<\/h2>\n\n<p>Osservo costantemente <strong>Interruzione<\/strong>- e DPC, mantengo aggiornati i driver e il firmware e utilizzo MSI-X ove possibile. Pianifico RSS e affinit\u00e0 per carico di lavoro in modo che flussi, DPC e thread rimangano locali. Adeguo la moderazione NIC agli schemi del traffico, distribuisco le code di archiviazione in modo pulito e utilizzo percorsi di I\/O adeguati. Se il monitoraggio mostra dei valori anomali, mi occupo direttamente dei driver, dell'hardware e della configurazione. In questo modo, il server di gestione degli interrupt rimane prevedibile e i miei carichi di lavoro vengono eseguiti con stabilit\u00e0. <strong>Prestazioni<\/strong>.<\/p>","protected":false},"excerpt":{"rendered":"<p>Scoprite come la gestione degli interrupt e gli interrupt della CPU influiscono sulle prestazioni dell'hosting. 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